基于FPGA的边缘设备深度神经网络检测程序

当机器学习遇上FPGA：深度神经网络推理技术的硬核解析

谈到机器学习时，很多人习惯将其视为一个黑盒——输入数据，就能得到预测结果。但本质上，这一过程是算法在解析数据、从中学习规律，进而做出决策或预测。与传统编程不同，机器无需为每个任务手工编写代码，而是依靠海量数据和算法自行“训练”并完成任务。

机器学习正经历一场深刻的变革，其核心引擎便是神经网络算法（NN）。简单来说，它模拟了人脑中生物神经元的结构——一个由数字模型构建的层级网络。从图像分类、大数据模式识别，到ADAS（高级驾驶辅助系统）、欺诈检测、食品质量评估乃至金融预测，神经网络的应用场景几乎无处不在。

作为机器学习的核心算法，神经网络拥有多种拓扑结构和规模。它通常由三层组成：输入层、隐藏层（可多层）和输出层。每一层中的隐藏神经元负责执行特定任务，并将结果传递至下一层，最终由输出层给出预测结果。

一些神经网络结构简单，仅有二至三层神经元；而深度神经网络（DNN）则可能包含多达上千层。针对具体任务，需要通过反复实验与对比，才能确定最适配的拓扑结构与网络规模。

为了构建高性能的机器学习应用，网络优化必不可少，常用的手段包括剪枝与量化。同时，计算加速也是关键环节——通常会借助ASIC或FPGA这类专用硬件来执行任务。

本文将深入探讨DNN的工作原理、FPGA在DNN推理中日益受到青睐的原因，以及开发基于深度学习的FPGA设计所需的核心工具。

DNN应用的开发流程

设计一个DNN应用通常包含三个步骤：选择合适的网络结构、训练网络，再利用新数据对已训练模型进行推理（即预测）。

如前所述，DNN模型包含多个层级，每一层都承担明确的功能。在深度学习中，各层负责提取不同层次的特征。例如，在边缘检测网络中，第一层可能检测边缘和曲线等初级特征；输出结果传递给下一层，该层进一步组合成更高级的特征，如半圆形或方块；第三层则将这些特征整合成可识别的目标。最终，输出层负责判定所见内容。

再举一个例子：若要识别一个停车标志，经过训练的系统会包含检测八角形、红色底色以及字母“S”“T”“O”“P”的层级。输出层则依据这些信息判断是否为停车标志。

DNN的学习模式

DNN的学习模式主要有四种：

监督学习：所有训练数据均带有标签，神经网络根据这些标签对输入数据进行分类。

无监督学习：深度学习模型接收数据集，但无明确处理指示，网络需自行提取特征、分析结构，挖掘数据内在规律。

半监督学习：训练数据同时包含有标签和无标签样本。这在特征提取困难或人工标注成本高昂的场景下尤为实用。

强化学习：通过奖励机制提升网络性能，是一个迭代过程——反馈轮次越多，网络表现越优。该模式在机器人领域应用广泛，例如训练自动驾驶汽车或管理仓库库存。

训练与推理的区别

在训练阶段，未经训练的神经网络从现有数据中学习新能力。模型训练完成后，便具备处理新数据的能力。准确识别目标的比率即称为推理。

以识别猫为例（图1），输入训练数据后，DNN开始持续调整权重——权重是神经元之间连接强度的指标。若结果错误，误差会反向传播至网络各层，修正权重。这一过程不断重复，直至网络找到最优权重组合，最终每次都能输出正确结果。

如何实现高性能DNN应用

使用DNN进行分类需要大规模数据集以提高准确率。但缺点也很明显：大数据集带来海量参数，导致计算开销和内存带宽需求激增。

DNN优化主要从两个方向入手。第一是通过网络优化缩小网络规模，具体方法包括修剪冗余连接、权重量化以及融合不同神经网络层。

剪枝：一种DNN压缩技术，通过减少神经元之间的连接数来降低数据总量。通常接近零的权重会被移除。对于分类等任务，剪枝能剔除冗余连接，但准确率会略有下降。

量化：神经网络使用低比特数（如INT8）近似浮点数（FP32）计算，大幅降低内存需求和计算成本。尽管精度略有损失，但对大多数应用而言，32位浮点精度并非必需。

第二个优化方向是计算加速，采用ASIC或FPGA等专用硬件。其中，FPGA在机器学习应用中具备诸多优势：

能效：FPGA仅调用所需计算资源，灵活性高。在ADAS等低功耗系统中，这一特性至关重要。

可重构性：与ASIC相比，FPGA是原始可编程硬件，开发周期短、上市快。对于日新月异的机器学习算法，随时对系统重新编程是一项巨大优势。

低延迟：FPGA内部的Block RAM与最快片外存储器相比，数据传输速度至少快50倍，这在延迟敏感的机器学习应用中堪称游戏规则改变者。

性能可移植性：无需修改代码或回归测试，即可享受下一代FPGA设备的性能提升。

灵活性：FPGA没有固定架构或数据路径，可针对任意架构进行配置，实现大规模并行处理，甚至可脱离主机CPU直接连接任何设备、网络或存储。

功能安全：FPGA用户可在硬件中实现任意安全功能，这在航空电子、自动化和安全领域已获充分验证。

成本效益：FPGA可重新配置，上市时间极短；而ASIC开发周期长、成本高，一旦出现设计错误代价巨大。

不过，现代FPGA虽拥有丰富的DSP和BRAM资源，但面对DNN的深度与层规模仍显不足——尤其当网络规模持续增大时。例如，Zynq MPSoC系列中最大型号也仅包含约2k个DSP片和不到10MB的BRAM，直接将所有神经元和权重映射到FPGA上并不现实。

那么，如何利用FPGA的功耗效率、可重新编程性和低延迟等优势来实现深度学习呢？关键在于引入全新的NN算法与架构改进，才能使DNN推理适应FPGA这类内存资源受限的平台

现代DNN的做法是将应用程序划分为较小的块交由FPGA处理。由于FPGA的片上存储器不足以容纳网络所有权重，只能将当前阶段的权重和参数存储在外部存储器（如DDR)中，再按需加载。

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